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[求助] 仿真问题

[求助] 仿真问题

本帖最后由 zhmzhmzhm 于 2018-3-12 21:16 编辑

将verilog代码综合转化为symbol后,不能进行tran仿真是什么问题。代码能够仿真。但是生成的symbol不能仿真。报如下错误,望大神解答。

ERROR (OSSHNL): Error(s) found during netlisting. The netlist may be corrupt  or may not be produced at all.

MQ54~I0R$`9Y`36C~~LEBGY.png
2018-3-12 19:20
OOB6_9K)H7[%)6CVB2.png
2018-3-12 19:18
OOB6_9K)H7[%)6CVB2.png
2018-3-12 19:24

仿真

MQ54~I0R$`9Y`36C~~LEBGY.png
2018-3-12 19:25
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