做综合时，插clock_gating 在设置clock_gating max_fanout需要参考什么

klw02 · 发表于 2018-1-19 18:26:09

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做综合时，插clock_gating 在设置clock_gating max_fanout 有什么好处，具体要参考什么？
filp-flop共享同一个使能信号时，插入越少的clock_gating cell 越有利于power的降低，那为什么有的情况还要设置 clock_gating max_fanout ?
是为了满足timing 要求吗？插入buffer 不是应该更节省面积吗？
如果是，设置clock-gating max_fanout 的值有什么要求或参考吗？

klw02 · 发表于 2018-1-22 18:13:13

自己顶一个，希望知道的大神可以给解答一下

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