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EETOP诚邀模拟IC相关培训讲师 创芯人才网--重磅上线啦!
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[求助] CPLD,FPGA,DSP内部结构

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发表于 2018-1-17 22:02:12 | 显示全部楼层 |阅读模式

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各位大神,小弟刚入门的硬件设计一枚。今天碰到问题了。然后引出以下疑问:
CPLD,FPGA,dsp的GPIO引脚内部分别是什么样的?通电前和通电后配置端口前后是什么样的状态。
万望解答,不胜感激!!!!
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