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查看: 5270|回复: 19

[求助] 求SV+UVM学习方向指点——刚接验证妹子一枚

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发表于 2017-11-16 11:09:40 | 显示全部楼层 |阅读模式

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IC验证刚接触的妹子一枚,刚看完systemverilog验证这本书,请问下一步该怎么学?
看张强的UVM实战?然后那,我看有人说让跑lab的,请问由lab资源吗。怎么搭建开发环境那?装虚拟机,安装linux系统,再装上vcs软件?
发表于 2017-11-16 12:29:22 | 显示全部楼层
回复 1# 乐在其中296


    Hi ,

可以去这里做练习:
http://www.edaplayground.com/
发表于 2017-11-16 14:42:54 | 显示全部楼层
最好说一下自身的情况,学生?工薪族?爱好者?不同的环境,有不同的方式方法。
 楼主| 发表于 2017-11-16 16:01:10 | 显示全部楼层
回复 3# gaurson


   研究生一名,专硕,明年9月就要开始找工作了
发表于 2017-11-17 14:30:13 | 显示全部楼层
现在研究生也开始搞验证的东西了?可惜不是容易出课题的东西,感兴趣可以。
 楼主| 发表于 2017-11-17 15:37:46 | 显示全部楼层
回复 5# gaurson


   为了找工作呗,做设计的一大片,怎么拼得过
发表于 2017-11-23 15:59:52 | 显示全部楼层
回复 2# glimmer


   这里面是做什么的,打开之后好像要登录啥的
发表于 2017-11-23 23:20:38 | 显示全部楼层
做这一行的难得有妹子
 楼主| 发表于 2017-11-24 09:11:28 | 显示全部楼层
回复 8# gui401


   阿,是吗,感觉学校这专业的女生还是不少的,难道她们都去做设计了。一提专业就后悔为什么大学不报文科,唉唉,如今头发都快秃了,想我90后小仙女都开始掉头发了。。。。。
发表于 2017-11-24 09:33:51 | 显示全部楼层
回复 8# gui401

还好吧,班上男女比例3:1
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