14bit 240MHz流水线ADC 测试结果非谐波杂散很多

ydhb11 · 发表于 2016-12-10 09:34:26

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本帖最后由 ydhb11 于 2016-12-10 10:13 编辑

无标题.jpg

如图，这是做FFT后的结果，可以看到非谐波杂散很多，且杂散的频率间隔大约为6MHz。信号幅度小的时候，这些杂散也跟着减小。信号幅度大的时候，就是图中的样子咯。

芯片用了0.18 CMOS 工艺，采用无SHA的结构。共五级，第一级是3.5Bit 。
输入信号经过自举开关后进入第一级3.5bit MDAC 和 4bit ADC。自举开关是常用的那种（电荷泵把栅压升上去，保持栅源电压恒定），MDAC的运放是经典的两级结构。

输入满量程是1.6Vpp。基准电压一个是0.5V，另一个是1.3V，由内部3V电源供电，采用的运放+源极跟随器（速度快）+大电容产生这两个内部基准电压。 3V电源是由1.8V电源泵上去的（类似于自举开关中的那个电荷泵），电荷泵时钟由时钟提供。

各位大神帮小弟分析下，这些非谐波杂散是从那里来的，我实在想不通啊？？？谢谢！！！！！！！！

zytian · 发表于 2016-12-10 17:43:23

把输入信号的幅度变一下观察杂散频率是否有变化

lonerinuestc · 发表于 2016-12-10 23:23:53

这估计是又搞的AD6649什么的

leave22 · 发表于 2016-12-11 14:36:21

回复 1# ydhb11

输入信号0的时候也有杂散吗

jinlilijin · 发表于 2016-12-12 17:36:51

回复 4# leave22

可能是

ydhb11 · 发表于 2016-12-12 17:40:30

回复 2# zytian

输入从-20dBFS开始增加，杂散幅度开始明显增加

ydhb11 · 发表于 2016-12-12 17:43:03

回复 4# leave22

输入0的时候没有任何杂散
不应该是输入自举开关的问题，如果是，那么谐波杂散应该比较大。

dundun22 · 发表于 2016-12-13 09:42:35

把频率降低

ydhb11 · 发表于 2016-12-14 18:50:28

回复 8# dundun22

频率降低也没用，还是有。
会不会是数字输出数据的最高几位没有采样正确？数据的DCO 延时因为设计失误，现在没法调整。

alhoceima111 · 发表于 2016-12-18 09:24:10

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