TCAM 24bits级联HSpice后仿真结果过差的原因

wzc4820269 · 发表于 2016-1-29 15:00:44

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GF 65工艺下画了一个CAM标准单元，CAM单元中有一个信号ML需要在画24bitsCAM的时候接在一起，其中ML为一个N管的漏极引出的信号，前仿结果显示大概ML输出大概约有200ps的延迟，后仿却惊人的约1.6ns,主要的寄生参数应该是N管24个并联的漏极电容有关，出于设计考虑N管的W/L我希望大一点，W/L是不是越大，漏电容C就越大啊？

laf01 · 发表于 2016-2-4 17:05:44

问题同上，求解

[求助] TCAM 24bits级联HSpice后仿真结果过差的原因

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