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楼主: winever

[资料] RTL Design Style Guide for Verilog HDL

发表于 2015-8-27 15:31:08 | 显示全部楼层

看看参考设计

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发表于 2015-11-1 18:56:50 | 显示全部楼层

好的，多参考下总是没错的

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发表于 2015-11-7 15:30:28 | 显示全部楼层

谢谢分享，收下了～

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发表于 2015-11-8 12:06:57 | 显示全部楼层

下来看看

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发表于 2015-11-9 16:39:23 | 显示全部楼层

Thanks

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发表于 2015-11-11 14:16:16 | 显示全部楼层

have a look

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发表于 2015-11-12 08:31:30 | 显示全部楼层

谢谢分享

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发表于 2015-11-12 11:09:43 | 显示全部楼层

好东东，顶起来。

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发表于 2016-1-15 07:06:22 | 显示全部楼层

very useful

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发表于 2016-1-20 22:20:30 | 显示全部楼层

关于代码设计，需要多多交流，多多推敲

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