悬赏《一种非二进制权重的高能效比逐次比较型模数转换器》文章下载

雨丝 · 发表于 2013-12-25 16:24:16

《一种非二进制权重的高能效比逐次比较型模数转换器》,万鑫;谈熙;-固体电子学研究与进展2013年第04期

摘　要：介绍了一种非二进制权重的高能效比逐次比较型模数转换器。该ADC采用了非二进制权重的电容结构以降低工艺失配对性能的影响,极大地减小了总电容的值;使用了自适应时钟来实现每一位的量化,提高了采样频率,并且不需要外界提供高速时钟;采用了注入扰动的最小均方校准算法,用很小的电路代价实现了后台数字校准。本芯片在SMIC 0.13μm工艺上实现,芯片模拟部分核心面积为0.042mm2,数字校准模块面积为0.04mm2,芯片工作在25MHz采样率时功耗为2.8mW,信噪失真比为58.6dB,有效位数为9.5位。

【出　处】	《固体电子学研究与进展》2013年第4期 382-388页　共7页
【收　录】	中文科技期刊数据库

悬赏200信元，限今天18：30之前。

lvwei_1024 · 发表于 2013-12-25 16:24:17

回复 3# 雨丝

Non-binary SAR ADC with digital error correction for low power applications.pdf (1017.62 KB, 下载次数: 180 )

雨丝 · 发表于 2013-12-25 16:33:56

本帖最后由雨丝于 2013-12-25 16:35 编辑

加一个Non-binary SAR ADC with digital error correction for low power applications
Published in:
Circuits and Systems (APCCAS), 2010 IEEE Asia Pacific Conference on
Date of Conference: 6-9 Dec. 2010

500信元悬赏所有关于 Non-binary SAR 的文章

雨丝 · 发表于 2013-12-25 16:57:43

本帖最后由雨丝于 2013-12-25 17:04 编辑

已下载

把悬赏发给下面这篇文章：
Non-binary SAR ADC with digital error correction for low power applications

雨丝 · 发表于 2013-12-25 18:06:05

继续求：

《A 12b 22.5/45MS/s 3.0mW 0.059mm2 CMOS SAR ADC achieving over 90dB SFDR》
IEEE International Solid—State Circuit Conference，2010：380—381．

《A 1.2V 10b 20MSample/s non-binary successive approximation ADC in 0.13μm CMOS》
IEEE International Solid～state Circuit Conference．2002：1 36—137．

colindeng · 发表于 2014-1-2 18:35:23

感謝分享

天蓝Lenore · 发表于 2015-12-13 20:04:25

回复 5# 雨丝

夏天里的绿荫 · 发表于 2016-5-28 11:43:06

谢谢分享

夏天里的绿荫 · 发表于 2016-5-28 11:44:21

谢谢分享

dashezhixue · 发表于 2016-11-18 19:19:45

回复 7# 天蓝Lenore

感谢分享。。。。。。。。。。。。。。。。

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