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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 状态机、加法器、乘法器设计合集
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楼主: seaboy6

[资料] 状态机、加法器、乘法器设计合集

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jackchen012
发表于 2013-1-24 09:14:56 | 显示全部楼层
Thx for your sharing
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tomcattw
发表于 2013-1-27 15:21:20 | 显示全部楼层
厲害厲害~~
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kahn01011
发表于 2013-3-23 16:13:28 | 显示全部楼层
顶。。。。。。。。。。。。
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罗高樵
发表于 2013-3-23 19:25:46 | 显示全部楼层
不错，顶一个
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欧美122
发表于 2013-4-16 13:37:38 | 显示全部楼层
下来看看先.
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bingjunpeng
发表于 2013-5-2 07:22:44 | 显示全部楼层
thank u
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luddylee
发表于 2013-5-8 08:54:42 | 显示全部楼层
提示缺少分卷09......
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xiaohua11111
发表于 2013-5-8 14:24:10 | 显示全部楼层
好东西，顶，学习了
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ireview
发表于 2013-5-8 14:38:55 | 显示全部楼层
很不错哦
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朝敏1990
发表于 2013-5-20 10:11:05 | 显示全部楼层
多谢了！
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