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楼主: hqhjj

[原创] 异步FIFO verilog代码

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发表于 2012-5-17 15:01:17 | 显示全部楼层
速度最高能有多快?
发表于 2012-5-25 00:28:46 | 显示全部楼层
看看 谢啦·
发表于 2012-6-12 16:46:02 | 显示全部楼层
I learn the aysnchrous FIFO verilog. But i have a question about the full/empty flag code problem. i don't understand the condition of the full flag. why? Can you simulate the code? the code is as follows:
always @(wr_addr_gray or rd_addr_gray_wsyn2)
begin
    if((wr_addr_gray[ADDR_WIDTH]!=rd_addr_gray_wsyn2[ADDR_WIDTH]) &&
       (wr_addr_gray[ADDR_WIDTH-1]!=rd_addr_gray_wsyn2[ADDR_WIDTH-1]) &&
       (wr_addr_gray[ADDR_WIDTH-2:0]==rd_addr_gray_wsyn2[ADDR_WIDTH-2:0]))
        full = 1'b1;
    else
        full = 1'b0;
end
发表于 2012-10-24 17:14:23 | 显示全部楼层
想请问楼主一个问题:代码中同步写指针到读时钟域用的是两级触发器串联打拍,同步读指针到写时钟域也是用两级触发器串联打拍。已知两级触发器串联这样的同步器使用条件是把慢时钟域信号同步到快时钟域,则上面的同步动作必有一个不满足。应该如何解决?
发表于 2012-11-19 15:22:11 | 显示全部楼层
=.=  看看
发表于 2012-11-20 12:19:44 | 显示全部楼层
好多 ,多谢了!!
发表于 2012-11-23 21:29:11 | 显示全部楼层
非常感谢,学习中~
发表于 2012-12-28 09:13:58 | 显示全部楼层
雪中送炭!
发表于 2013-3-5 18:02:06 | 显示全部楼层
学习了,谢谢
发表于 2013-3-19 09:48:45 | 显示全部楼层
现在正需要这个呢
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