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楼主: lucien_1986

[原创] FIFO使用技巧

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发表于 2013-3-1 09:03:23 | 显示全部楼层
FIFO是个挺好用的缓存~为了防止数据的丢失,可以使用FIFO来进行缓存,同时也是解决跨时钟域问题的好方法
发表于 2013-3-5 21:46:46 | 显示全部楼层
我有个和wrfull相关的问题不知道LZ能帮忙看下可以不?
我现在在做一个信号采集模块,输入端74M时钟产生两路串行数据,转成16位数据后进异步FIFO,另一端接133M时钟的SDRAM。我想问下关于写FIFO的wrfull这个信号,持续时间是否和某些信号有相关性?
再细点说就是SDRAM设计为突发读写8个字的模式,然后在FIFO这里设置为深度为8的实例,当wrfull有效时,产生写入SDRAM的一个信号。现在遇到的问题和wrfull的持续时间相关。在signaltap中发现wrfull有时持续4个写时钟,有时又持续8个写时钟,请问wrfull信号的持续时间是变化的么?如果是可变的,和哪些因素有关联?
谢谢
发表于 2013-4-26 16:05:44 | 显示全部楼层
说的挺好,实际中有时也这么用过
发表于 2013-5-1 18:06:27 | 显示全部楼层
支持原创
发表于 2013-5-20 20:05:35 | 显示全部楼层
fifo理解下
发表于 2013-5-20 22:42:29 | 显示全部楼层
看是觉得简单,还是得自己多做点这方面的实践才能有属于自己的心得,谢谢分享
发表于 2013-12-1 10:51:51 | 显示全部楼层
嗯嗯,容易理解!!
发表于 2013-12-3 22:36:31 | 显示全部楼层
FIFO用来做速率转换处理跨时钟域的问题,相当不错
发表于 2013-12-4 13:23:24 | 显示全部楼层
学习了,不错
发表于 2014-5-2 12:37:17 | 显示全部楼层
谢谢,收益了
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