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楼主: buley

[统计] 你是用VHDL还是用Verilog HDL？

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空山新雨
发表于 2012-3-28 16:34:43 | 显示全部楼层
VHDL，以后转型方便！
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shibinyou
发表于 2012-3-30 22:43:10 | 显示全部楼层
verilog 易上手。。简单些
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tzling
发表于 2012-4-2 17:37:02 | 显示全部楼层
喜欢VHDL
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simonyangq
发表于 2012-4-3 08:36:39 | 显示全部楼层
更喜欢verilog HDL，贴近算法
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anglela
发表于 2012-4-4 06:01:53 | 显示全部楼层
verilog
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frinos
发表于 2012-4-4 09:26:40 | 显示全部楼层
都用一些，根据项目
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tgwljh
发表于 2012-4-5 19:29:59 | 显示全部楼层
用verilog
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thomas66
发表于 2012-4-6 00:27:22 | 显示全部楼层
WERILOG
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quenstin
发表于 2012-4-8 22:13:12 | 显示全部楼层
两个都会用，但是现在一直在用verilog，比较灵活，VHDL要求比较呆板
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supreme42
发表于 2012-4-18 01:03:28 | 显示全部楼层
不用说，verilog是主流了
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