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[求助] PLL unit can't cross over by any core-logic power rail

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发表于 2011-6-12 22:20:07 | 显示全部楼层 |阅读模式

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在SMIC的I/O说明文档中,讲I/O和IP核应用时候有这样句话(假设IP核为PLL)——
PLL unit can't cross over by any core-logic power rail。

不太理解 core-logic power rail是什么东西
请教各位
谢谢
 楼主| 发表于 2011-6-14 09:56:08 | 显示全部楼层
有人知道吗?
发表于 2011-6-23 01:07:06 | 显示全部楼层
core-logic power rail,个人理解是指VDD/VSS等power线,避免信号干扰。
假设PLL是4层,而整个chip是6层,在调用PLL时,无论Power还是digital走线都不能在Analog Block上走,通常还要留点距离。
发表于 2011-6-23 11:45:51 | 显示全部楼层
偶是来学习的
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