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[求助] LVS 验证时出现问题

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发表于 2011-3-30 15:17:58 | 显示全部楼层 |阅读模式

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本帖最后由 yxic 于 2011-3-30 15:51 编辑

在做LVS验证的时候,将这些配置文件导入之后,点击run LVS 的时候,提示以下的错误..“source primary cell not found in source database”。在网上找到一相关的帖子,但是没有明白其道理。其中有个帖子说道:

“你的netlist 沒有top cell name 。如果你的top cell name 是 OPA, 那你的netlist應該是 :( .SUBCKT OPA”-难道是top cell name 有问题??

我做LVS时候,提示错误如下图所示:
QQ截图未命名.jpg

我也是头一次碰到这个情况,不知道该如何下手,希望有高手指点。
发表于 2011-3-30 15:21:56 | 显示全部楼层
还要钱才能看主题啊,晕倒,
发表于 2011-3-30 15:27:21 | 显示全部楼层
哈哈,问你问题是给你面子
个人观点,纯属娱乐
 楼主| 发表于 2011-3-30 15:52:54 | 显示全部楼层
回复 2# icfbicfb


   不好意思,刚才发帖子的时候没注意。。。让你破费了。。。。
发表于 2011-3-30 15:58:27 | 显示全部楼层
就是top cell name的问题
 楼主| 发表于 2011-3-30 16:08:44 | 显示全部楼层
回复 5# yangics


   关于这个问题能说的详细点吗??是不是针对的.SPI 文件中的??该文件中 .SUBCKT 后面的名字??在这个文件中,有多个 .SUBCKT ,但是我不知道改选什么。在做LVS的时候,多次更改top  name ,还是报错。。。。
发表于 2011-3-30 16:14:38 | 显示全部楼层
这似乎不是到spi文件中选择的吧,你要跟哪个电路图做LVS难道不知道吗?
spi文件怎么来的
 楼主| 发表于 2011-3-30 16:21:21 | 显示全部楼层
回复 7# yangics


   是用v2lvs把 .vg 转成.spi的了。其语句为: 1.jpg
发表于 2011-3-30 16:29:00 | 显示全部楼层
那就是verilog的top module name呗
发表于 2011-3-30 20:47:03 | 显示全部楼层
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