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楼主: jiancongwoo

[讨论] 讨论65nm以下工艺的Timing Signoff的问题

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 楼主| 发表于 2011-6-23 07:28:48 | 显示全部楼层
回复 21# sznbman


    哈哈打击你一下,我后端工作2年,前端1.5年的样子。
离8年还差老大一截呢。
发表于 2011-7-21 17:54:53 | 显示全部楼层
学习了
发表于 2011-7-21 18:35:31 | 显示全部楼层
回复 1# jiancongwoo


    请教一下OCV的几个问题
1 看PT manual, OCV 和BC_WC的区别不是很理解,只是表现在setup时,OCV计算capture用min delay么?
2 有几个概念有点混淆 比如对于Max delay我的理解是 一个cell或者net的max_delay = 在worst case下面的最晚到达输入或者最大的transition导致的delay ,所以timing arc的max delay就是由以上的delay构成,这样理解正确吗? 这个在OCV下面有改变吗,除了要乘上一个derate系数?
3 OCV 整体上来看,给我的第一感觉就是过约束,大家对它和工艺上的对应有什么自己的看法吗?
初学PT,希望能够不吝赐教~
发表于 2011-7-23 05:59:46 | 显示全部楼层
thanks...
发表于 2011-7-24 20:08:07 | 显示全部楼层
学习一下
发表于 2011-7-25 11:23:01 | 显示全部楼层
标记一下。。。谢啦
发表于 2011-7-26 20:20:49 | 显示全部楼层
回复 2# jiancongwoo


    温度反转什么意思,难道温度上升电阻还下降吗?
发表于 2014-4-6 01:28:08 | 显示全部楼层
Signal Integrity related issues are more in lower technologies!
发表于 2014-4-6 02:14:19 | 显示全部楼层
No Cells Landlord!
发表于 2014-6-26 01:11:47 | 显示全部楼层




    path based应该是比graph based乐观吧
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