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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › 关于 verilog中 for 的综合问题
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楼主: apachee

[解决] 关于 verilog中 for 的综合问题

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zuidongting
发表于 2010-6-7 22:49:07 | 显示全部楼层
完全没有问题、可以综合
大胆写吧
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zuidongting
发表于 2010-6-7 22:50:53 | 显示全部楼层
10# lihelun2003

呵呵，不难学了，我才学了一年。跟着一个学长。
现在就在用FPGA写控制参加一些比赛呢。。。
呵呵，6月14号初赛成绩就出来了，希望有好的结果
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