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详细解释用上拉与下拉电阻的原因以及什么时候用(zt)

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发表于 2009-2-7 07:54:18 | 显示全部楼层 |阅读模式

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网上看到的。满有意思的。

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电阻的上拉与下拉
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在网上看到一些对电阻的上拉和下拉不太明白的,输入端的上拉及下拉非常简单但也非常重要。

上拉:通过一个电阻对电源相连。下拉:通过一个电阻到地。

上下拉一般有两个用处:提高输出信号的驱动能力、确定输入信号的电平(防止干扰)。

用过8051的都知道cpu的I/O上通常接有排阻(上拉到5V),这里主要是为了提高输出驱动能力的。因为8051的CPU不是标准的I/O口,输出为低电平时可以吸收均20mA的电流,但输出为高的时候是通过内部一个很大的电阻上拉的,输出高电平时驱动能力很差,所以就通过外部上拉来提高电平输出驱动能力。

一般一个三极管的基极都有两个电阻,一个限流一个上拉或下拉,此处的上下拉主要为了确定输入信号的电平。其实目标是为了防止干扰,因为器件的输入接口一般内阻都很大,很容易受干扰。接一个上下拉电阻其实也就是降低了输入阻抗,提高了抗干扰能力。

一般元器件不用的输入口通要求接上拉或下拉电阻。注意,不用的输出接口就不要接东西了。



拉电流和灌电流就是从芯片外电路通过引脚流入芯片内的电流,区别在于吸收电流是主动的,从芯片输入端流入的叫拉电流,灌入电流是被动的,从输出端流入的叫灌入电流。

上拉和下拉的区别是一个为拉电流,一个为灌电流

一般来说灌电流比拉电流要大

也就是灌电流驱动能力强一些

当逻辑门输出端是低电平时,灌入逻辑门的电流称为灌电流,灌电流越大,输出端的低电平就越高。由三极管输出特性曲线也可以看出,灌电流越大,饱和压降越大,低电平越大。逻辑门的低电平是有一定限制的,它有一个最大值UOLMAX。在逻辑门工作时,不允许超过这个数值,TTL逻辑门的规范规定UOLMAX ≤0.4~0.5V。

       当逻辑门输出端是高电平时,逻辑门输出端的电流是从逻辑门中流出,这个电流称为拉电流。拉电流越大,输出端的高电平就越低。这是因为输出级三极管是有内阻的,内阻上的电压降会使输出电压下降。拉电流越大,高电平越低。逻辑门的高电平是有一定限制的,它有一个最小值UOHMIN。在逻辑门工作时,不允许超过这个数值,TTL逻辑门的规范规定UOHMIN ≥2.4V。

       由于高电平输入电流很小,在微安级,一般可以不必考虑,低电平电流较大,在毫安级。所以,往往低电平的灌电流不超标就不会有问题,用扇出系数来说明逻辑门来同类门的能力。扇出系数No是低电平最大输出电流和低电平最大输入电流的比值.对于标准TTL门,NO≥10;对于低功耗肖特基系列的TTL门,NO≥20
发表于 2009-2-9 14:53:19 | 显示全部楼层
不错,分析的很透彻。。。。。
发表于 2009-2-10 22:41:30 | 显示全部楼层

hao

八错八错!!有水平!!有内涵!!
发表于 2009-3-24 18:53:47 | 显示全部楼层
很好,很详细
发表于 2009-3-25 10:36:27 | 显示全部楼层
很好,学习了,谢谢
发表于 2009-3-25 11:32:52 | 显示全部楼层
不错,分析的很透彻。。。。。
发表于 2009-3-26 11:39:41 | 显示全部楼层
学习了~~~~~~~哈哈~~
发表于 2009-3-27 21:22:24 | 显示全部楼层
透彻
发表于 2009-4-1 16:01:40 | 显示全部楼层
谢谢楼主,
发表于 2009-4-1 20:31:30 | 显示全部楼层
输入的上下拉,一般是在浮空情况给输入一个状态;输出一般是拉到某个电平
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