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genghis

发表于 2007-12-29 15:38:19 | 显示全部楼层 |阅读模式

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algorism方向（十四篇）

[ 本帖最后由 genghis 于 2007-12-29 16:02 编辑 ]

低功耗

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Algorithmic and architectural transformations for low power realization of FIR filters.pdf

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Algorithmic low power FIR cores.pdf

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dev-Fully depleted CMOS-SOI device.pdf

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device design.pdf

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device,technology.pdf

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device.pdf

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devices,SOI technology.pdf

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Logic design.pdf

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Logic Style.pdf

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logic style-Pass-transistor dual value logic.pdf

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logic styles-- CMOS versus pass-transistor logic.pdf

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logic styles for full-adder.pdf

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logic style-Selectively clocked skewed logic.pdf

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asynchronous方向（两篇）

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95Is asynchronous logic good for low-power.pdf

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branch-based logic tayle方向（四篇）

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12-Low-power design of 8-b embedded CoolRisc microcontroller cores.pdf

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cdfg方向（两篇）

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92Equivalent design representations and transformations for interactive scheduling.pdf

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93Scheduling of a control data flow graph.pdf

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charge方向（11篇）

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00A multi-level multi-phase charge-recycling method for low-power AMLCD column drivers.pdf

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01A low power charge-recycling ROM architecture.pdf

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03A low-power charge-recycling ROM architecture.pdf

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97Design of low power CMOS drivers based on charge recycling.pdf

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99A low power charge-recycling CMOS clock buffer.pdf

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99CMOS Pass-gate No-race Charge-recycling Logic.pdf

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99Modular charge recycling pass transistor logic (MCRPL).pdf

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99No-race charge-recycling differential logic (NCDL).pdf

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charge sharing scheme.pdf

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楼主| 发表于 2007-12-29 16:00:20 | 显示全部楼层

circuit方向（14篇）

circuit-content-addressable memory.pdf

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cir-drivers.pdf

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cir-Dynamic circuits.pdf

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cir-dynamic CMOS logic and rom.pdf

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cir-filter2.pdf

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cir-filter.pdf

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cir-Input synchronization.pdf

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cir-multiplier.pdf

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cir-PLA.pdf

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cir-selftimed design.pdf

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cir-SRAM 2.pdf

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cir-SRAM.pdf

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gated-clock方向（6篇）

5-Low power FSM design using Huffman-style encoding.pdf

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6-A clock-gating method for low-power LSI design.pdf

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6-Low-power embedded microprocessor design.pdf

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10-Saving power by synthesizing gated clocks for sequential circuits.pdf

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14-Automatic synthesis of low-power gated-clock finite-state machines.pdf

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楼主| 发表于 2007-12-29 16:09:05 | 显示全部楼层

glitch方向（23篇）

4Analysis and reduction of glitches in synchronous networks.pdf

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5-96Glitch analysis and reduction in register transfer level power optimization.pdf

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5A new lower power Viterbi decoder architecture with glitch reduction.pdf

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5Low power and high speed explicit-pulsed flip-flops.pdf

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abbr_7e9558b85b18ed4cece102cbe89469ca.pdf

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A complete model for glitch analysis in logic circuits.pdf

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A low-power and high-speed dynamic PLA circuit configuration for single-clock CMOS.pdf

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glitch方向

A non-zero delay model for glitch analysis in logic circuits.pdf

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A power optimization method considering glitch reduction by gate sizing.pdf

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A practical gate resizing technique considering glitch reduction for low power design.pdf

528.26 KB, 下载次数: 28 , 下载积分: 资产 -2 信元, 下载支出 2 信元

Accurate logic-level power simulation using glitch filtering and estimation.pdf

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Clocking strategies and scannable latches for low power applications.pdf

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F-gate-- a device for glitch power minimization.pdf

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glitch方向

Glitch power minimization by gate freezing.pdf

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Glitch power minimization by selective gate freezing.pdf

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G-vector-- a new model for glitch analysis.pdf

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Incorporation of input glitches into power macromodeling.pdf

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New approach in gate-level glitch modelling.pdf

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Short circuit power consumption of glitches.pdf

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Ultra low power digital signal processing.pdf

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