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[求助] 计数器输出做时钟,对后端有什么影响么?

[求助] 计数器输出做时钟,对后端有什么影响么?

比如一个free counter, 我用其最低位产生2分频时钟
有两种写法:
1。  直接将Q端做为后续逻辑的时钟
2。  将Q端输出作为enable,与clock做gating后输出作为时钟


前端这两种写法对后端有什么不同影响么?
除了Q端的驱动能力可能不够,需要插buffer之外,还有啥问题没

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