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查看: 13659|回复: 8

[求助] 版图跑LVS的时候提示supply error detected怎么解决

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发表于 2017-7-12 19:20:49 | 显示全部楼层 |阅读模式

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本帖最后由 Russoul 于 2017-7-12 19:25 编辑

DRC通过 但是LVS提示supply error detectded 要如何解决 我为了简化连线 好几个PMOS的衬底没有直接用metal 1连接到最上面的VDD,而是在衬底的metal 1上直接打label 是这个问题吗?    layout里同样的label只能打一次吗?  求高人指点 谢谢谢谢谢
 楼主| 发表于 2017-7-12 19:23:46 | 显示全部楼层
用的 cadence virtuoso
发表于 2017-7-13 08:49:05 | 显示全部楼层
回复 2# Russoul


    1. label 需要加:
    2. virtual connect colon 这个option 没有设成YES
 楼主| 发表于 2017-7-13 12:33:09 | 显示全部楼层
回复 3# jhdu


   同名字的label超过1个就都要加“:”吗?  如果没有重名的label 不加“:”也是正确的
发表于 2017-7-13 17:18:33 | 显示全部楼层
回复 4# Russoul


    看情况, 如果两条net没有连起来就需要加:,同时你的virtual connect colon 要设成YES;如果是连起来就不需要,而且打多少个同名的label都没关系
发表于 2017-7-13 18:01:36 | 显示全部楼层
也可以不加“:”,把Virtual connect name 设置为“?”就可以了,表示只要同名就默认互联。不过这个option有风险,wholechip最好关掉。
发表于 2022-10-7 14:04:22 | 显示全部楼层
我遇到的几种情况:1.lable层没打对 2.VCC和GND没注意接到一起去了(找了半天)
发表于 2022-12-14 16:39:33 | 显示全部楼层
这种情况就是电源地有问题,还是注意一下比较好
发表于 2023-3-27 19:58:36 | 显示全部楼层


jdh215933 发表于 2022-10-7 14:04
我遇到的几种情况:1.lable层没打对 2.VCC和GND没注意接到一起去了(找了半天) ...


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