verilog 100例外加一个详细课程设计!值得研究

zhentizhi · 发表于 2006-12-2 13:31:52

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实例分为两部分，第1部分连续输入数据处理的电路设计是我们的课程设计，有详细的设计过程（分析过程，数据流图，以及状态机，源代码仿真和综合电路图），另一个是老师给的例题，有100多个例子吧，不过只有源代码和题目。希望能给大家做一个参考！以我的经验觉得在学习verilog的初始阶段多看看设计的示例,然后再模仿编写一些自己的程序这样进步可能会更快一点吧!
总的来讲连续输入数据处理的电路设计设计不是很难，有兴趣的朋友还可以对这个设计做一些改进！

wnyuanwei · 发表于 2006-12-6 09:41:45

我是一个初学者,非常感谢大家无私奉献

dadaowaiguozhu · 发表于 2006-12-7 19:50:18

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dadaowaiguozhu · 发表于 2006-12-7 19:52:38

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denap · 发表于 2007-8-11 23:12:44

Thanks for sharing!!

wind_88 · 发表于 2007-8-12 10:55:08

学习学习。。。。。。。。。

奔驰的拉芳 · 发表于 2007-9-21 16:04:01

a ...xiexieha ..

slove9999 · 发表于 2007-10-5 21:40:31

have a look。。。。

slove9999 · 发表于 2007-10-5 21:43:27

多谢楼主分享。。。

hheehhuu2003 · 发表于 2007-12-13 21:30:25

顶顶顶！

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