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暴多的verilog设计实例,均有原代码!!

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发表于 2006-12-1 17:37:03 | 显示全部楼层 |阅读模式

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     实例分为两部分,第1部分连续输入数据处理的电路设计是我们的课程设计,有详细的设计过程(分析过程,数据流图,以及状态机,源代码仿真和综合电路图),另一个是老师给的例题,有100多个例子吧,不过只有源代码和题目。希望能给大家做一个参考!!
   总的来
讲连续输入数据处理的电路设计设计不是很难,有兴趣的朋友还可以对这个设计做一些改进!!
      


verilog设计.rar

347.24 KB, 下载次数: 5413 , 下载积分: 资产 -2 信元, 下载支出 2 信元

verilog 设计

发表于 2006-12-2 11:51:49 | 显示全部楼层
ddddddddddddddddddddddddddddd
发表于 2006-12-4 22:23:05 | 显示全部楼层
不错不错!
头像被屏蔽
发表于 2006-12-6 01:12:56 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
发表于 2006-12-6 17:14:15 | 显示全部楼层
不错不错的,楼主辛苦啊
发表于 2006-12-7 17:33:28 | 显示全部楼层

回复 #1 zhentizhi 的帖子

有fifo的吗?
头像被屏蔽
发表于 2006-12-7 19:14:22 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
发表于 2006-12-12 17:20:44 | 显示全部楼层
好东东啊!楼主好人啊!谢谢了!
发表于 2006-12-14 14:13:18 | 显示全部楼层
顶一个,谢谢楼主了
发表于 2006-12-24 17:59:26 | 显示全部楼层
我这段时间正在学习这个,下来看看
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