做lvs遇到一怪异问题，求高手解答！！

wuchuanqi · 发表于 2011-8-15 00:20:26

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电路有几个模块构成，整体做lvs显示已经match，点击yes看结果，却出现其中一个模块parameter有错误，显示此模块有的器件尺寸不匹配，但是这个模块单独做lvs也是match，求高手解答肿么回事？？谢谢啦！急！！

onlykals · 发表于 2011-8-15 10:18:26

可能是你的multi 或者 finger數與schematic上的不同,

但最後比對的size是一樣的

icfbicfb · 发表于 2011-8-15 23:48:39

没关系吧，如果是property相关错误，要看下，

比如-hier lvs ，顶层过了，下面有可能有property error的，比如电阻，电容值不对，

这个经常有的，

onlykals · 发表于 2011-8-16 09:49:14

其實這樣說都不是很保險,
要是可以擷取 report 裡面的 error message就更好了.

wuchuanqi · 发表于 2011-8-16 12:33:04

本帖最后由 wuchuanqi 于 2011-8-16 12:46 编辑

回复 4# onlykals

谢谢帮助！本来是用Assura做的lvs，对于这个问题它没有给出更多错误信息，改用Calibre来做，lvs也是过了，可是显示有啥ERC错误，对这个比对工具不熟，也不知道具体是什么原因？郁闷。。。补充：錯誤內容: J. |3 k& u8 N
ERC Pathchk Polygons" m/ j+ m1 M# a: ~6 J
' I# w/ y+ u1 ~; Z$ Y! Z
ERC PATHCHK POWER && GROUND NOFLOAT

wesley_wan · 发表于 2011-8-16 17:44:14

ERC保险起见你最好是找懂电路的人过目一遍

duchao881001 · 发表于 2011-8-18 17:32:54

还有一种可能你的电路都是对称的如果有的地方接反了，子cell是对的但是整体上会报你有些尺寸不对，建议从头再查一遍版图

wangboxxf · 发表于 2011-8-18 20:11:01

erc 是什么呀

onlykals · 发表于 2011-8-22 09:36:19

電性上的確認, 像是一顆mos的source跟drain同時接到 power 跟 gnd,
或者是NW接到gnd, psub接到power 諸如此類
但詳細內容就看cmd怎麼寫
p.s. 不一定erc有錯就是真錯, 有時可能是電路上的特殊用法, 請與designer討論.

scuay · 发表于 2011-8-22 17:17:36

可以先看看出错地方对应的电路，检查一下体端的连接情况。一般默认是VDD|GND。有些设计里会连到别的信号，那么ERC过程中就会报错。解决办法是忽略或者添加新的的电源/地，我建议是后者。

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