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查看: 4714|回复: 6

[讨论] 关于BUFR的问题

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发表于 2010-4-21 10:05:03 | 显示全部楼层 |阅读模式

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看到BUFR只能驱动区域内逻辑,加两个相邻区域,最多3个时钟区域;
我做了个简单测试,诸如BANK22的一个CC输入作为clock 经过BUFR;
BANK13,BANK14分别一个管脚输入信号;
CLK采样后 输出到BANK34一个管脚。
对于管脚来说 跨了几个column,ISE却没有报错;
why?
这个最多3个区域怎么理解呢?
发表于 2010-4-21 10:35:06 | 显示全部楼层
LZ用的是V几的FPGA?
 楼主| 发表于 2010-4-21 11:11:19 | 显示全部楼层
2# emaklutz
V6的
不过BUFR在4、5、6都有了的
 楼主| 发表于 2010-4-21 14:42:43 | 显示全部楼层
1# airtd
算 我自己回复一个;
只驱动一个pin脚没有报错,后来针对pin脚使用IDDR和ODDR就报错了;
这里驱动相邻区域是按照bank的号划分的,诸如23上面CC可以驱动22和24bank
发表于 2010-4-21 18:16:32 | 显示全部楼层
学习了,顶一下!
发表于 2017-11-5 10:14:17 | 显示全部楼层
学习了@@!@@
发表于 2017-11-6 20:26:54 | 显示全部楼层
学习了!!!!
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