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usb_vrilog_code不錯的usb設計參考

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发表于 2009-10-2 23:39:25 | 显示全部楼层 |阅读模式

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usb_vrilog_code不錯的usb設計參考

Usb RTL (VHDL & Verilog).zip

3.31 MB, 下载次数: 291 , 下载积分: 资产 -2 信元, 下载支出 2 信元

不錯的usb設計參考

发表于 2009-10-3 00:13:31 | 显示全部楼层
Thanks
发表于 2009-10-3 15:01:16 | 显示全部楼层
谢谢楼主分享
发表于 2009-10-3 16:19:33 | 显示全部楼层
thanks!!
发表于 2009-10-16 16:22:43 | 显示全部楼层
学习学习!
发表于 2009-10-23 12:00:01 | 显示全部楼层
哪里找来的??看看是否有用
发表于 2009-10-23 12:34:29 | 显示全部楼层
ddddddddddd
发表于 2009-10-28 16:32:20 | 显示全部楼层
怎么没详细介绍啊
发表于 2009-10-28 16:53:18 | 显示全部楼层
thanks
发表于 2009-10-28 17:13:53 | 显示全部楼层
有个问题,不知是漏洞否:某个页面下,只要有附件,刷新的时候,没点下载,刷新一次都得扣信元啊
.......不知大家发现没?
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