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龙芯RTL Verilog到C翻译器的设计与实现

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发表于 2008-7-12 20:00:20 | 显示全部楼层 |阅读模式

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       龙芯的设计者“胡伟武”研究员所带的硕士写得论文,想学习mips的兄弟下来看看不错,(CAJ格式);
      本文的研究结果作为中国科学院计算技术研究所龙芯cpu课题组研究工作的一部份,已应用于龙芯CPU设计早期的性能分析和系统评估。

龙芯RTLVerilog到C翻译器的设计与实现.rar

611.35 KB, 下载次数: 564 , 下载积分: 资产 -2 信元, 下载支出 2 信元

 楼主| 发表于 2008-7-13 14:28:04 | 显示全部楼层
真的是不错的资料
发表于 2008-7-14 14:40:04 | 显示全部楼层

good

gooooo
发表于 2008-7-16 15:11:02 | 显示全部楼层
发表于 2008-7-16 19:21:18 | 显示全部楼层
最后那只被剃毛的猫好可怜
发表于 2008-7-17 20:26:09 | 显示全部楼层
是猛料乎?????
 楼主| 发表于 2008-7-18 17:04:16 | 显示全部楼层
猛料!!
发表于 2008-7-19 03:25:01 | 显示全部楼层
Thanks for sharing
头像被屏蔽
发表于 2008-7-23 15:20:06 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
发表于 2008-7-23 15:55:40 | 显示全部楼层
thanks!!!!!!!
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