在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
[求助] set_false_path fangwang85 2024-2-22 3360 fangwang85 2024-2-23 09:02
[求助] 求购logicbricks logiVIEW ip linuxsina 2024-2-22 0219 linuxsina 2024-2-22 22:52
投票 [原创] 大家过年放假都有几天? liguchu 2024-1-18 4961 murphy522 2024-2-22 17:28
悬赏 [求助] 数字模块内部寄存器的最大size - [悬赏 30 信元资产] GloriaMoran 2024-2-22 1356 chengkunjie 2024-2-22 14:07
[求助] 各种寄存器常用设计惯例,比如写1清0,影子寄存器,把sram当寄存器等,哪本教材有写? erwang 2024-2-1 1361 adan313 2024-2-22 12:42
[资料] [databook] EMMC_PHY attachment itzme 2021-12-24 72484 菠萝赛东 2024-2-22 11:03
悬赏 [求助] 做DC综合时出现Error: Width mismatch on port - [已解决] SuperLYL 2020-4-21 65429 tjz1127 2024-2-22 10:27
[原创] 前端设计的代码优化 数学必考150 2024-1-12 6680 naNo_cc 2024-2-21 09:38
[原创] 这么多培训班,有没有讲DSP+FPU的培训班啊? orientview 2024-2-5 5499 kk2009 2024-2-21 02:00
[资料] tsmc90nm standard cell可用于练习 attachment  ...23456..8 yangyanwen123 2020-8-2 7914624 xckl123123 2024-2-20 18:28
[原创] 基于FPGA的AD/DA采集(附件代码原码) attachment xuehua_12 2018-11-13 84617 finelei2002 2024-2-20 17:43
[求助] waveview如何查看数组类型的变量 iceplanet 2024-2-19 1238 gaurson 2024-2-20 17:32
[求助] idelay2 相位对齐问题 xapp855 attachment 听风漫步 2024-2-20 1215 听风漫步 2024-2-20 15:19
[求助] 书上说“严格控制信号”的输入时序可以不约束,什么叫“严格控制信号”? attach_img 日晨难再 2024-2-19 1375 nuobeierjiang 2024-2-20 08:15
[原创] MIPI I3C白皮书 attach_img castlerock 2023-8-30 4714 infortrans 2024-2-20 07:46
[求助] Synplify requires license DesignWare 新人帖 yalida 2022-4-13 31341 edgar8818 2024-2-19 21:44
[求助] 求大佬帮忙,DDR4 PHY 的clock 对source PLL 有没有精度的要求 lewis.l.l 2024-2-1 7459 mismatch24 2024-2-19 18:05
[求助] DW库中流水线乘法器综合问题求助 新人帖 天才鼓手 2024-1-30 6446 Kiss_Rose 2024-2-19 17:30
[求助] 请有modelsim 2022.2版本的大侠共享下 gdutchen 2024-2-19 0301 gdutchen 2024-2-19 16:26
[讨论] 有用过S家的ddrc吗?? scutlee 2024-2-19 0327 scutlee 2024-2-19 14:51
[求助] 求助对华大九天Xtime软件有经验的大佬 xkzxcv123 2024-2-19 3334 xkzxcv123 2024-2-19 14:26
[求助] STM32 F0 prefetch问题 attach_img neXtime 2024-2-19 0238 neXtime 2024-2-19 10:39
[求助] 模块使能信号的作用 Wade_ 2024-2-18 2354 Wade_ 2024-2-18 16:22
悬赏 [求助] ARM-SOCRATES 中Nic400配置的问题 - [悬赏 500 信元资产] attach_img Liang_Xiaoqian 2024-1-30 2483 Liang_Xiaoqian 2024-2-18 14:02
[资料] 【分享电子书】新一代通用视频编码H.266VVC:原理、标准与实现 attachment  ...2 zywttt 2024-1-26 13613 wang1051005157 2024-2-18 10:44
[求助] 求IEEE paper attachment kk2009 2024-2-7 6434 九尾龟 2024-2-17 22:17
[求助] 请教一下一些存储器内部的寄存器作用 xiaokai66 2024-2-2 4389 xiaokai66 2024-2-17 14:53
[原创] 据说Bluespec比Chisel,更加优秀,是真的吗? orientview 2022-5-14 52415 abeey 2024-2-16 11:02
[求助] 时钟端口也能添加input_delay吗? 日晨难再 2024-2-15 0380 日晨难再 2024-2-15 16:59
[讨论] 关于upf设计中的电源域切换 yex 2024-2-2 2389 kk2009 2024-2-15 08:33
[求助] lib库中的slew_derate_from_library究竟影响了什么? 日晨难再 2024-2-9 0318 日晨难再 2024-2-9 16:19
[求助] 请问formality可以做RTL-RTL的验证吗? irun2 2013-7-3 61927 smc1017 2024-2-7 18:16
[求助] Verilog初学,新人求助 attach_img 2558966080 2024-2-3 8553 767781537 2024-2-7 16:17
[求助] 浮点数算法逼近问题 xbllzf 2024-2-2 4445 xbllzf 2024-2-5 16:29
[求助] VHDL可以直接定义浮点数或定点小数?verilog不行吧? haxy 2016-3-29 47005 andy2000a 2024-2-5 15:45
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /3 下一条

×

小黑屋| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-4-18 20:42 , Processed in 0.018262 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块