在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
[求助] 想请教一下FPGA中的LUT和DFF都是用在verilog中的什么语句情况中呢? yanzhengkuaile 2011-9-6 45849 yanzhengkuaile 2011-9-6 11:09
[求助] 求助一个verilog语法问题~请大家帮我 yanzhengkuaile 2011-8-29 31811 yanzhengkuaile 2011-9-6 10:05
[求助] STA,report_timing遇见 no constraint的错误 sages 2011-9-5 01445 sages 2011-9-5 22:59
[求助] I2C中速率的设置问题 刺猬精灵 2011-9-5 67349 buley 2011-9-5 22:59
[求助] 求助。关于quartus综合后,出现的时钟建立时间为负的情况 xiaoli055 2011-9-2 38695 xiaoli055 2011-9-5 19:37
[求助] TLV320AIC32芯片的配置问题 beifengwx1100 2011-9-4 53825 falloutmx 2011-9-5 15:50
[求助] 关于时钟的问题:分频后的时钟可以与原时钟一起用吗?  ...2 追天鹅的青蛙 2011-7-6 124624 buley 2011-9-5 15:18
[求助] 寻求VCS 能够支持system verilog 的license creese 2011-9-4 13415 demonsolar 2011-9-4 20:15
[求助] quartus 综合和布线执行不下去了,各位有没有遇到类似的情况 ffbone 2011-9-4 12145 hugetable2004 2011-9-4 20:06
[求助] 关于FIR滤波器的问题 attach_img blueandy 2011-9-3 52370 hugetable2004 2011-9-4 20:01
[求助] 关于DDS二进制数据出来后如何让生成图像呢  ...2 sarah.china 2011-8-30 125782 guoyu 2011-9-4 10:46
[求助] 请问standalone BSP上跑的是什么系统,谢谢! smeiyang 2011-9-3 01733 smeiyang 2011-9-3 14:30
[求助] spartan 6 bufio2用法 110500623 2011-9-1 46620 110500623 2011-9-2 17:02
[求助] 谁用过射频芯片可以输出350-500MHz 模拟信号? laokai 2011-9-2 31879 laokai 2011-9-2 16:20
[求助] 请教 什么样的时钟才是好的时钟? 怎样判定时钟信号的好坏? zhtxwd 2011-8-18 66350 zhtxwd 2011-9-2 15:49
[求助] 请教CPLD的问题 haisking 2011-8-30 41904 wxxhn 2011-9-2 14:34
[求助] 关于FPGA的AD转换有人做过么? lincoln24 2010-5-24 63008 MOSFET 2011-9-2 10:41
[求助] xilin spartan 系列,如何烧写到FPGA上,通过 JTAG henrybai 2010-10-19 32684 RainskyXiang 2011-9-1 17:29
[求助] verilog 寫I2C (補充波形圖) attach_img devilfish 2011-9-1 12075 leona1527 2011-9-1 11:32
[求助] Modelsim编译Testbench出错了 sarah.china 2011-8-31 76500 dlb05061131 2011-9-1 11:00
[求助] ISE对Modelsim库编译90%处出错,紧急求租 attach_img 1988saladin 2011-8-31 32598 demonsolar 2011-9-1 10:27
[求助] 模拟IC从零开始学,路该怎么走!  ...23 winzi 2011-8-9 225992 winzi 2011-8-31 12:51
[求助] 发送 控制字 到 AD9910的 SPI, 经常需要发送2次??? yzgolden 2011-3-29 32956 jianguang007 2011-8-30 22:00
[求助] vhdl,if语句中可不可以包含两个信号的沿触发呢  ...2 sarah.china 2011-6-13 149219 snowinmoon 2011-8-30 17:27
[求助] FPGA开发板的恒流源问题 attach_img zhjyu1123 2011-8-30 01635 zhjyu1123 2011-8-30 14:11
[求助] quartus 调用 modelsim的问题 jinsongpo 2011-8-24 72376 dlb05061131 2011-8-30 13:00
[求助] 求个Quartus以太网IP能用的license,版本无所谓,论坛里试了好多都不行,谢谢! jlfeieee 2011-8-29 24151 jlfeieee 2011-8-30 11:57
[求助] 基于fpga的nand flash的设计 adu5229543 2011-8-30 06745 adu5229543 2011-8-30 10:55
[求助] 关于VERILOG读多个文件的问题 hoho0ohoh 2011-8-30 02013 hoho0ohoh 2011-8-30 09:06
[求助] 多周期路径中的检查保持时间时刻,为什么默认是在建立时间检查的前一个cycle? huanguestc002 2011-8-27 12409 post_design 2011-8-29 17:43
[求助] 请问网上下的IP核如何使用 attach_img mingtian2010 2011-8-29 01846 mingtian2010 2011-8-29 14:33
[求助] fpga怎么学啊 年华似水 2011-8-3 13034 match_filter 2011-8-29 11:33
[求助] 芯片设计的第一步为系统设计,各位给点详细的操作过程嘛 jom55555 2011-8-29 02220 jom55555 2011-8-29 10:10
[求助] 如何自己手动搭建时序逻辑 subrant 2011-8-27 21462 jackertja 2011-8-29 09:53
悬赏 [求助] FPGA 求助 - [已解决]  ...2 down_load 2011-8-15 154769 gangersun 2011-8-29 09:23
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /3 下一条

×

小黑屋| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-4-19 16:28 , Processed in 0.045211 second(s), 10 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块