在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
收藏本版 (87) |订阅

IC验证讨论 今日: 3 |主题: 6515|排名: 17 

[讨论] calview.cellmap的设置问题 weiyue 2012-4-6 14396 569038754 2016-4-1 16:41
[讨论] LVS问题 林瑞 2016-3-29 01519 林瑞 2016-3-29 10:50
[讨论] 如何评估一个SOC架构的优劣? lmwzm 2016-3-12 43180 matlinsas 2016-3-17 18:55
[讨论] uvm验证问题,如何停住DUT里面一个RTL的运行 smalldog 2016-3-13 12100 AnswerLJ 2016-3-15 19:00
[讨论] 公司都使用什么样的验证方法? lmwzm 2016-3-15 01612 lmwzm 2016-3-15 18:46
[讨论] 破解verdi的一个问题  ...2 DZ小亮 2013-1-30 138762 ye_hong_lei 2016-2-27 23:50
[讨论] case与验证环境的划分界限? zsftm 2016-1-19 22145 A1985 2016-1-20 13:52
[讨论] 哪位大侠用过mentor的stilverify这个工具? liqiang998 2016-1-13 01885 liqiang998 2016-1-13 14:15
[讨论] 请教如何在ovm/uvm中通过顶层test传参数给intereface? Ameteur 2015-12-24 12107 Ameteur 2015-12-30 21:10
[讨论] 如何对断言的输出进行定向 AnswerLJ 2015-12-24 01702 AnswerLJ 2015-12-24 15:46
[讨论] [转]Verilog/Systemverilog/UVM simulation online yyzbest 2015-12-6 11808 qpbcl3 2015-12-7 10:53
[讨论] uvm 芯片中存在多个模块级联的情况,请问级联内部的信号怎么监测的? attach_img allencherry 2014-9-11 63572 Ameteur 2015-12-3 22:49
[讨论] DDR3 DQS 测量到的信号的回沟比较大,跟那些原因有关 attach_img 北極企鵝 2015-10-23 32653 lazybear 2015-11-30 10:22
[讨论] Verilog VHDL 排版插件 luoyanghero 2015-11-24 21725 haitaox 2015-11-25 09:02
[讨论] vcs 覆盖率整合 TT50524 2013-3-12 12602 jeffej 2015-11-14 10:02
[讨论] 求问做验证有啥经典论文? ustccrz 2015-11-2 21524 ustccrz 2015-11-8 10:39
[讨论] DRC验证的时候 xihi5400 2015-11-3 11525 朱子Ting 2015-11-3 13:51
[讨论] systemverilog在module中例化program的问题 attach_img 似水如烟 2015-10-28 84079 似水如烟 2015-11-2 09:15
[讨论] 调用VCS工具跑仿真时会出现调用libsscore_vcsxxx.so,这是一个什么样的文件? SMHILYCM 2015-10-30 01816 SMHILYCM 2015-10-30 14:41
[讨论] Monitor 中为什么要定义3个数组? macrohard 2015-10-20 31480 macrohard 2015-10-20 16:37
[讨论] UVM中reference model的问题 woloven70 2015-7-7 11768 willym 2015-9-27 13:26
[讨论] sv中类的声明/嵌套 似水如烟 2015-9-16 01906 似水如烟 2015-9-16 11:02
[讨论] 仿真软件 醉夕阳妃 2013-8-30 12346 hekaidi 2015-9-8 15:21
[讨论] 【分享】用urg压缩代码覆盖率vdb文件 gxlong 2014-11-29 13066 twieain 2015-8-31 18:02
[讨论] 求助,一个有关UVM验证的问题  ...2 DZ小亮 2013-1-24 1810895 huanghx 2015-8-28 11:55
[讨论] 关于vcs的功能覆盖率(functional coverage)的问题  ...2 hi_johnson 2011-5-26 1111225 mlqe 2015-8-12 14:49
[讨论] 求教:testbench中的case机制,./simv+case名仿真不同case的实现方法 益达。我的 2015-8-2 42168 zzczx 2015-8-5 06:06
[讨论] 电子束修改芯片内部金属线 小支 2015-7-1 21925 小支 2015-7-4 15:17
[讨论] UVM 的随机化问题。。。 macrohard 2015-6-17 11803 macrohard 2015-6-17 11:33
[讨论] SystemVerilog中的Transaction要怎么理解 ajzcr 2015-4-28 42786 bearhero2114 2015-5-13 09:27
[讨论] 高手进,芯片ESD电路问题!? attachment  ...23 hehejiuaixiao 2010-7-13 249737 3011204070 2015-5-7 18:16
[讨论] Questa 中能否只记录一段波形? macrohard 2015-4-30 31715 macrohard 2015-5-6 11:15
[讨论] SV & UVM linting wayneruby 2015-4-24 31633 seabeam 2015-4-26 23:15
[讨论] 请教一个混合电路的时序验证问题 muduo 2015-4-20 41891 eagle654321 2015-4-24 09:56
[讨论] UVM 验证中 Pack 和 Unpack 的问题。。。 macrohard 2015-4-22 45315 macrohard 2015-4-23 09:47
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /3 下一条

小黑屋| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-4-19 12:58 , Processed in 0.020023 second(s), 8 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块