数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 30082|排名: 8

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FFT ASIC 芯片典型应用	inside 2004-8-13	14553	greatrebel 2004-8-31 22:39
如何在modelsim如何设置默认为16进制，，	yn800323 2004-8-24	83706	greatrebel 2004-8-31 20:18
ise5.x中仿真波形的生成问题?	yanglei 2004-8-31	01564	yanglei 2004-8-31 14:43
请教一个std_logic_textio与synplify综合问题	micronsun 2004-8-31	12608	atuhappy 2004-8-31 12:08
cou core	tonyliu76 2004-8-30	02163	tonyliu76 2004-8-30 17:51
哪位做过DMA controller	atuhappy 2004-8-30	51750	yn800323 2004-8-30 16:43
求Design for Test/Manufacturing方面的书，万分感谢！！ (无内容)	goodhope 2004-8-30	01731	goodhope 2004-8-30 11:08
我问一个关于给pci加iobuf的问题	yn800323 2004-8-29	01622	yn800323 2004-8-29 19:47
急切求助:SE54的timing_driven的布局布线方法	hitlzh 2004-8-11	21955	hitlzh 2004-8-29 13:06
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再问一个问题，关于SYNPLIFY综合的一个警告	wjx197733 2004-8-25	32894	brotherjam 2004-8-28 01:22
USB 设计中的疑问？？	ttlgate 2004-8-27	21895	ttlgate 2004-8-28 01:07
输出为U态是什么原因？	cybernauts 2004-8-26	11649	atuhappy 2004-8-26 17:40
请推荐一本清楚讨论流水线设计的Verilog教材	craftfox 2004-8-26	02396	craftfox 2004-8-26 17:13
为什么功能仿真能实现的到了时序仿真波形就出错了呢？ ...2 3	cybernauts 2004-8-24	216770	cybernauts 2004-8-26 10:04
请问：如何在综合时使用第三方的库，如library xilinxcorelib	micronsun 2004-8-24	12288	bravelu 2004-8-24 22:21
HELP 我想知道verilog中读内存文件的格式	hypee 2004-7-20	64216	abull 2004-8-23 17:31
请问一个IO口定义为 inout时，信号冲突的问题	wunone 2004-8-19	43211	foxcom 2004-8-23 10:04
求助：LABs是什么意思	zhdang 2004-8-20	217110	liuiang 2004-8-23 08:54
要找工作了，大家给介绍介绍 ...2	showting 2004-8-9	134876	棒槌 2004-8-22 01:27
请教：一块板子上四个FPGA xc2s50的供电问题~	johnbenben 2004-8-16	22118	chenbgfyl 2004-8-21 18:19
怎么把一段调试号的程序封装成一起器件呢？（vhdl)	cybernauts 2004-8-20	62991	bravelu 2004-8-21 12:55
国内最大最专业的IP库	ssipex 2004-8-12	11902	xinmiao21 2004-8-20 20:32
[求助]请教一个很急很急的问题	kuangbin 2004-8-18	11497	洋洋 2004-8-18 18:31
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